”LO和接收器可将6 GHz的调制64至中频= 0.8兆赫

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您好所有。我试图使接收器可将6 GHz的调制64至中频= 0.8千兆赫。我有坏的BER = 5 * 10 ^ -6的不断扫荡。我不知道该怎么办。当我中频信号
， 有线电视接收器和电视机我应用看到的图片
， 有时褪色。信噪比大于35分贝。也许我应该改变我的路。劳带VCO HMC431lp4组成的频率合成器的ADF4156。什么样的环路滤波器的带宽
， 我应该选择？15kHz或30千赫
， 以改善黄连？我模拟的模拟设备我在ADIsimPLL劳。项目附如下。
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你为什么直接怀疑劳/合成器？我会先调查是否有不同的载波互调失真是不阻止你。电视放大器总是需要非常非常大的退避的线性。

你有specsheet和架构？

 
Radiohead的说：

你为什么直接怀疑劳/合成器？
我会先调查是否有不同的载波互调失真是不阻止你。
电视放大器总是需要非常非常大的退避的线性。你有specsheet和架构？
 
我只是看看你的项目快速浏览并提出了一些修改（我不是真的的ADIsimPLL熟悉，但我一直试图尽我所能）。
在我看来
， 你有一个较大的噪音VCO的飞来
， 所以我也扩大了带宽和相位裕度。
集成相位噪声低现在（这是1.3在原始文件现在是1.0度度）
我也删除了过去极
， 似乎对我没有帮助。

试试这个配置
， 看看您是否信噪比提高。

顺便说一下，你有一个真正的相位噪声测量杂散？也许真正的系统正在执行不同的方式对于模拟（有时发生..）

是什么让我担心的是
， 在报告中一句：
第一分数N支线位置（估计）
第一分数N 3.25：105kHz
该软件并没有考虑到降解的刺激。如果这是不良业绩的根本原因，我的建议会给你最坏的结果（因为我扩大带宽，刺激会更高）。

我希望它可以提供帮助。

忍冬
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忍冬谢谢你了很多。我来试试明天当我在工作中我。但是你能explan如何计算的集成相位噪声？偏最小二乘

 
蒲公英说：

该软件不适合你，在报告页面。忍冬
 
马刺可以生成不同来源：
参考，fractionality是主要的。

作为20千赫的最低的国家之一
， 而车内体重（50千赫），它不是过滤循环过滤掉。

你有两个选择：

1。明白有什么刺激来自和尝试修改你的电路
， 以避免其发电（例如，如果说到。从参考，改变参考频率）

2。减少环路滤波器带宽
， 以便筛选出来。
但在这种情况下
， 你需要有一个非常小的体重（“1千赫），将增加不少
， 稳定时间（但如果这不是你isue，你可以这样做），并在您的情况，提高阶段噪声（如你会看到你再次VCO的噪声）。

因此
， 我建议你的第一个方法。
你已经知道这个马刺从何而来？

忍冬

 
您好忍冬。在第一次帮助表示感谢。

从我看的参考信号。我是27MHz的参考和马刺队是在30 dBc的54MHz之间（二次谐波）和81 MHz的20 dBc的（第三次谐波）。也许我应该设计过滤器
， 以减少这些谐波。你认为这将有助于？

 
不要担心你的参考时钟的谐波。
您的参考信号只是要干净的“内部”去你的体重锁相环：弗洛，体重的弗洛 体重（多一点当然是由于带外杂散是在20dB/dec衰减
， 然后在40分贝等..依赖对极数）。

问题：它isvery难以检查referenceclock纯度，因为锁相环将“放大”的同比例20log（不适用参考）
如果你想在6GHz的-110dBc/Hz的相位噪声和你有一个100MHz的参考，您应该检查的参考噪声低于- 110 - 20log（100分之6000）=- 145dBc/Hz！

我的印象中你首先需要澄清的劳规范。
最大均方根相位误差
最大杂散电平以dBc

然后你可以选择一个VCO和PLL电路根据您的需要。
在这里
， 您有没有西格马一个小数架构三角洲。可以预计在相当低的频率偏移的杂散相当高的水平。
如果您与这条赛道
， 你需要找到最佳体重，但你也可以尝试避免一些分数比率（即产生的低频过滤音）。新增1小时后50分钟：“也许我应该设计过滤器
， 以减少这些谐波。你认为这将有助于？

没有欢迎的谐波这里自PLL的第一个块是一个分隔。该阶段是唯一重要的事情。理想情况下，参考信号是一个方波（H3的，很多带有H5 ...).
如果您输入的正弦波作为参考信号波形，你可能更加敏感
， 电源噪声上转换。

 
同意courcirc8。

我建议你下面的测试：

锁相环频率设置是一个参考频率的整数倍，例如5562.000兆赫（27 * 206），看看它的低频率马刺队依然存在。由于没有分数的比例，不得分割刺激。

如果马刺队没有改变，大公从另一个问题来。

忍冬

 
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