关于异步FIFO和双端口SRAM

[vtmc]

曾经在接受采访时，我说我知道一些异步FIFO的概念，并要求解释。我提请框图和我开始之前
， 有关如何控制在/溢出等等等等，面试者说：“停止，如何ü设计的双端口SRAM的？这是最困难的部分。”。

我非常惊讶
， 因为我从来不知道这是最重要的部分。我没有采取任何异步FIFO的课程。我所做的是谷歌关于这一主题的一些文件，然后阅读一些高密度脂蛋白的例子。在所有这些例子中，提出的SRAM与高密度脂蛋白几行
， 是一个非常简单的块。

我的问题是，作为自我学习，什么样的resourse或方法可以帮助这种类型的缺陷我呢？这看起来似乎很明显在该行业的人士
， 但不适合我，3个月
， 学生毕业硕士。

谢谢您的帮助。

 

[ljxpjpjljx]

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[prashanthknl]

退房链接到了解RAM或由萨米尔Palnitkar预订该Verilog HDL的其他搜索
http://www.asic-world.com/examples/verilog/ram_dp_sr_sw.html

 

[Guest]

[No message]

 

[Guest]

不要指望知道
， 在您的研究甚至学习你的自我暗示和所有的设计技巧！你需要时间来获得这方面的知识...而且将通过建立多年...

现在，只要尝试读了很多...约需...不同的资源
， 从设计
， 信息阅读博客和有关设计的技巧经验丰富的工程师的意见...

最好的博客我一个建议是：

http://asicdigitaldesign.wordpress.com/

目前
， 我正在设计一个FIFO的，我看到的最重要的部分是不是内存控制器
， 不像你的采访...！..所以大家有不同意见
， 也...您要什么？？

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[Guest]

塞勒马阿里贝克尔说：最好的博客我一个建议是：http://asicdigitaldesign.wordpress.com/

 

[Guest]

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[cheelgo]

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[vtmc]

嗨，

谢谢大家的帮助。想你是与学习和建议的网站感谢多种来源的权利。

BTW，这个家伙是一个高通的原则工程师，所以我猜他可能会看到一个不同的看法的事情...我不知道。主考人都很好，但是这个过程吸cuz我搞砸了T_T