A
Adam2008
Guest
我正在混合信号电路。在模拟部分contais被动组件将手动完成布局。不过,我使用的数字图书馆
, 不包含网表或布局信息了。布局时将实例化制造的芯片。我如何能够在整个模拟电路layour之前提交编造?
谢谢。
, 不包含网表或布局信息了。布局时将实例化制造的芯片。我如何能够在整个模拟电路layour之前提交编造?
谢谢。
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