Jul 13, 2011 #1 A aahmadd Guest 嗨，我试图写在VHDL代码，接受1输入，其他（CLK和RST），并给出了2种不同的输出。例如，输入11输出/ 0110，以B / 0011。因此，如果第一个输出是0110，那么第二个输出将0011和保持这样的，从来没有2相同的连续输出，如电路运行。请帮助我。预先感谢。
嗨，我试图写在VHDL代码，接受1输入，其他（CLK和RST），并给出了2种不同的输出。例如，输入11输出/ 0110，以B / 0011。因此，如果第一个输出是0110，那么第二个输出将0011和保持这样的，从来没有2相同的连续输出，如电路运行。请帮助我。预先感谢。
Jul 13, 2011 #2 B bigdogguru Guest 你描述的是一个“有限状态机”：[报价]一个有限状态机（FSM）的一般模型的组合逻辑和顺序组件，如状态寄存器，它记录的电路状态由更新同步时钟信号的上升沿。输出函数计算的各种输出[/QUOTE]根据不同的状态，这听起来像你需要一个很好的VHDL文本引用。用VHDL设计 - 伟大的书，价格合理[/URL]，如果你做一个状态机的VHDL的搜索，您会看到大量的教程和例子。 [URL = http://web.engr.oregonstate.edu/〜traylor/ece474/new_vhdl_pdfs/state_machines_in_vhdl.pdf]密克罗尼西亚教程[/URL]很好的例子，应该让你在正确的方向前进。
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Jul 13, 2011 #3 D dilinx Guest 最好的VHDL的书（VHDL编程：例如由Douglas L.佩里） http://www.amazon.com/Vhdl-Douglas-L-Perry/dp/0070494363
