”SystemC的会死?

B

bigrice911

Guest
几年前
, 很多人说SystemC的将是完美的VHDL和Verilog和替代它的gonna是新一代高效的高密度脂蛋白。但是到目前为止,还没有的SystemC在高密度脂蛋白阶段甚至作为一个次要的角色。

Synopsys公司宣布
, 他们将放弃SystemC的EDA软件开发。

基于SystemC的所有努力被证明是一种堕胎?

<img src="http://www.edaboard.com/images/smiles/icon_question.gif" alt="问题" border="0" />
 
Jak na razie tablet Microsoftu dostępny jest w USA, Kanadzie i Japonii. Od 28 sierpnia 2014 wyląduje on na dwudziestu pięciu kolejnych rynkach. Czy jest na tej liście Polska?

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2个原因
, 我认为:
1。SystemC的硬件不能代表很好的性质和明确。
2。SystemVerilog和其他语言的出现。

 
我不这么认为。

将SystemC的系统级建模(事务级模型)和综合(Forte Design公司的Cynthesizer,CoWare公司,Mentor Graphics公司)。听起来像是在进化道路的VHDL经历。如你所知,最初设计的VHDL仿真。

SystemC模拟支持可以从
1。的ModelSim 5.8(版本6.0的SystemC移植到Windows版)
2。视觉精英
3。Aldec公司里维埃拉
4。Celoxica公司
5。节奏
....

在RTL级,HDL的是最好的。因此,Verilog的(SystemVerilog的)和VHDL(版本200倍),将被使用。

在由G.马丁要从以下文件节奏。(图表!)
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有任何comapny开始使用HDL或建模SystemC语言?
什么语言的现状。有电机及电子学工程师联合会recongize呢?

 
索尼公司在1998年左右使用SystemC的硅谷和完成他们的项目。

 
我不认为SystemC是一个非常值得核查或HDL语言好。据我所知,很多公司所用的系统建模。

 
我在“思”的朋友说,系统C没有一个很好的前景。

 
是的,我也是。
我听到Synopsys公司销售该系统- C是不好的。
也许是Synopsys公司的业务技巧。因为他们现在正在推动的SystemVerilog。

 
SystemC是良好的系统设计。
我们刚刚开的SystemC设计一个庞大的通信系统。
这是非常有效
, 并且最好的,它可以通过系统的家伙做。

现在您可以合作,模拟与表面等离子体波和端口从表面等离子体波您退出设计SystemC的SystemC的。

 
刚才听到CoWare公司得到了来自Cadance表面等离子体波队。最近,权证制度得到真正sucessful。我在寻找一些基于窗口的硬件awear工具SystemC模拟器。任何人有线索?

 
我认为SystemC是好的,虽然我没有SystemVerilog的想法。

Synopsys公司一直在推动的SystemVerilog成为一段IEEE标准,现在是。因此
, 可以宣布放弃新思科技的SystemC。

Cadence Incisive的提供SystemC的良好支持。诺瓦斯也提供接口倾销SystemC的信号家庭岗位歧视条例格式。

我相信
, 任何事情的SystemC模型可以SystemVerilog可以模型。因此
, 这不是一种语言的不同,如果对这种高级语言模拟引擎是一样的高密度脂蛋白的。这是你的最爱。

 
我是SystemC的有力支持者。我认为它不会死
, 至少在今后6-7年。它有一个创造的也可以在testbanches重复使用过程中依然强大的功能

 
现在在我的项目,从系统设计的系统规范
, 是在SystemC的,我们需要实施高密度脂蛋白的话,我认为双方的设计语言是不同的设计水平非常有用。

 
SystemC的并不好
, 因为预期在年开始。因此
, 这将是取代新的SystemVerilog语言
, 如,电子语言或杰达。

 
我认为,强劲的SystemC将在5-10年。现在,一些工具支持SystemC 2.0如ModelSim的,....

我们知道
, 迅速执行SystemC的系统级建模强烈。

 
SystemC综合没有很好的支持,
但它的功能强大的系统建模。

 
我也支持SystemC的,现在许多EDA供应商发布的工具
运行它。

 

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